Blind Via PCB: regole di progettazione, tipologie di costruzione, costi e guida

A cieco tramite PCB Si tratta di un circuito stampato in cui una o più vie collegano uno strato esterno di rame a uno specifico strato interno senza attraversare l'intero spessore del circuito. Il foro inizia dalla superficie e si ferma – precisamente – sul rame interno di destinazione, che funge da superficie di terminazione fisica durante la foratura laser. Questa singola proprietà fisica distingue i PCB con vie cieche dai circuiti stampati multistrato standard in tre modi significativi: la via occupa solo gli strati che collega, anziché consumare spazio di routing su tutti gli strati; il diametro del pad è più piccolo (tipicamente 0.25-0.35 mm rispetto a 0.50-0.70 mm per i fori passanti), consentendo una geometria di fanout geometricamente impossibile con la foratura meccanica; e la via non presenta stub di rame inutilizzato al di sotto dello strato di uscita del segnale, eliminando le risonanze dello stub a quarto d'onda che degradano i canali superiori a 10 Gbps. Questa guida è pensata per ingegneri hardware, progettisti di PCB e responsabili degli acquisti che devono prendere decisioni concrete sui PCB con via cieche: se utilizzarli, quale tipo di costruzione specificare, quali regole di progettazione sono irrinunciabili e cosa distingue un produttore competente da uno che fallirà su larga scala.

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Cos'è un PCB con via cieca e cosa lo rende diverso

Le tre strutture via nelle schede HDI

Perché le vie cieche aumentano la densità di instradamento

Su un circuito stampato standard a 10 strati, un via passante trasporta un segnale da L1 a L2, ma occupa lo spazio dei pad su tutti e 10 gli strati. Ogni strato attraversato perde un canale di routing per ogni via presente nel progetto. Con 200 via di segnale passanti su un circuito stampato ad alta densità, la penalità di routing si accumula sull'intera pila di strati.

Una via cieca da L1 a L2 utilizza solo quei due strati. I restanti otto strati non presentano alcuna ostruzione da parte del pad proveniente da quella via. In combinazione con il diametro del pad più piccolo (una via cieca da 0.10 mm con un pad di 0.30 mm rispetto a un foro da 0.30 mm con un pad da 0.60 mm per una via di segnale standard), questo è ciò che rende fisicamente realizzabile un fanout BGA con passo di 0.50 mm e 0.40 mm. A questi passi, il vincolo geometrico è assoluto: il diametro del pad più l'anello anulare di una via passante supera la spaziatura del passo, quindi una via cieca non è una scelta prestazionale ma una necessità topologica.

Definizione IPC-T-50M

Secondo la norma IPC-T-50M, una microvia (termine utilizzato negli standard IPC per indicare una via cieca realizzata con foro laser) è una struttura cieca con un rapporto di aspetto massimo di 1:1 e una profondità totale non superiore a 0.25 mm, misurata dalla lamina di captazione alla superficie di destinazione. Le strutture che superano questa profondità o questo rapporto di aspetto non rientrano nella definizione di microvia IPC e richiedono una valutazione ingegneristica per l'affidabilità della placcatura. Questa non è una linea guida, bensì il limite che definisce se la chimica di placcatura in rame può raggiungere in modo affidabile il fondo del foro della via.

Tre scenari in cui le vie cieche rappresentano la scelta ingegneristica corretta

Nella maggior parte dei progetti non sono necessarie vie cieche. La decisione dovrebbe essere dettata da una delle tre condizioni ingegneristiche specifiche, non dal desiderio di complessità del circuito stampato o dalla convinzione che l'HDI implichi una qualità superiore.

Scenario 1: Le forze di passo dei componenti creano un'impossibilità geometrica

Questo è il trigger più chiaro e comune. Con un passo BGA di 0.65 mm, un via passante da 0.30 mm con anello anulare da 0.15 mm per lato richiede un pad da 0.60 mm, che rientra appena nello spazio di 0.65 mm tra le sfere. Con un passo di 0.50 mm, la stessa geometria non è più adatta: pad da 0.60 mm > passo da 0.50 mm. Un via cieco da 0.10 mm con un pad di terra da 0.30 mm rientra entro 0.50 mm con un certo margine.

Con un passo di 0.40 mm, il vincolo si fa ancora più stringente. Anche i via ciechi da 0.10 mm potrebbero richiedere una configurazione via-in-pad, ovvero il posizionamento del via direttamente all'interno del pad del BGA, poiché non esiste un canale di instradamento tra i pad adiacenti per la fuga convenzionale. Non si tratta di una preferenza di instradamento; la geometria del fanout non offre altre soluzioni.

Scenario 2: La risonanza dello stub via degrada l'integrità del segnale al di sopra di ~10 Gbps

Un foro passante che collega L1 a L4 su una scheda a 16 strati lascia uno stub di rame da L4 a L16. Questo stub si comporta come una linea di trasmissione aperta non terminata. La sua frequenza di risonanza a quarto d'onda è:

f = c / (4 × L_stub × √ε_r)

Per uno stub da 1.5 mm in FR4 (ε_r ≈ 4.3), questa risonanza si verifica a circa 12 GHz. A tale frequenza, lo stub riflette l'energia del segnale nel canale, creando una perdita di inserzione che può superare i 15 dB, un valore catastrofico per qualsiasi interfaccia SerDes che operi in prossimità o al di sopra di tale frequenza. Secondo le specifiche IEEE 802.3 100GBASE-CR4, la perdita di inserzione massima a 12.5 GHz è di 1.5 dB per via; uno stub da 1.5 mm supera questo valore di un ordine di grandezza.

Foratura posteriore Rimuove la maggior parte dello stub, ma lascia un segmento residuo di 0.1-0.2 mm a causa della tolleranza di posizionamento della foratura. Per canali a 56 Gbps PAM4 (28 GHz Nyquist) e superiori, questo stub residuo rimane elettricamente significativo. Un via cieco non ha stub per costruzione: è l'unico approccio che elimina completamente la risonanza dello stub indipendentemente dalla frequenza.

Per PCIe Gen 3/4 e DDR4 con velocità di 8–16 Gbps, si raccomanda la modellazione della risonanza degli stub prima di specificare i via ciechi: la foratura sul retro di una scheda standard può essere sufficiente e considerevolmente meno costosa. Per SerDes a 112G, PCIe Gen 5/6 e DDR5-6400+, i via ciechi sono in genere la soluzione ingegneristicamente corretta.

Scenario 3: Impossibile rispettare il vincolo di area della scheda con la configurazione multistrato standard

Un progetto può essere realizzato in modo pulito su una scheda standard a 8 strati di 110×85 mm, ma deve adattarsi a un contenitore di 85×65 mm. La tecnologia HDI con fanout di via cieche e via-in-pad recupera l'area riducendo l'ingombro di ciascun pad di via e consentendo l'instradamento dei BGA direttamente nella via sotto il pad, eliminando completamente il canale di fuga. La scheda HDI ha un costo maggiore per centimetro quadrato, ma il costo totale di assemblaggio può essere inferiore se la scheda più piccola riduce i costi, il peso o la complessità di assemblaggio del contenitore. Si tratta di un compromesso a livello di sistema che richiede una modellazione accurata dei costi, non un'ipotesi predefinita.

Le vie cieche non sono la scelta giusta quando: il passo BGA è ≥0.65 mm con un'area della scheda adeguata; le frequenze del segnale sono inferiori a 5-10 Gbps, dove la risonanza dello stub non è misurabile; l'area della scheda non è limitata; oppure il prodotto è in una fase iniziale di prototipo in cui sono previste revisioni del progetto e i tempi di consegna HDI (8-21 giorni contro 5-7 giorni per il multistrato standard) rallenteranno l'iterazione.

Regole di progettazione dei via ciechi: accoppiamento degli strati, dimensione del pad, rapporto d'aspetto e via-in-pad

Accoppiamento degli strati: il vincolo fisico non negoziabile

Un via cieco può attraversare esattamente un singolo strato dielettrico. Il laser abla il prepreg esterno e si arresta sul primo strato di rame che incontra: questo strato di rame interno rappresenta la superficie di arresto fisica. Non è possibile che un singolo via cieco colleghi L1 a L3 in una struttura in cui è presente uno strato di rame L2 tra di essi; lo strato di rame L2 interrompe il laser prima che raggiunga L3.

Questo è l'errore di progettazione HDI più costoso e non ha una soluzione economica. Un progetto che specifica vie cieche L1→L3 in una costruzione di Tipo I (1+N+1) richiede un completo ri-instradamento degli strati di fuga HDI quando viene rilevato durante la revisione DFM. La regola è semplice da enunciare e spesso violata: in una costruzione di Tipo I, le vie cieche collegano L1 solo a L2 (e sono speculari sulla faccia inferiore come L(n)↔L(n-1)). Una connessione a due livelli richiede una costruzione di Tipo II o due vie separate — una L1→L2 e una L2→L3 — con un pad di cattura intermedio su L2.

Per i meccanismi completi del perché la sequenza di laminazione crea questo vincolo, vedere il Guida al processo di laminazione PCB cieca.

Dimensionamento delle piazzole di terreno: l'errore di registrazione è il vincolo determinante.

Il laser stesso posiziona con una precisione di ±25–35 µm. Il problema è che il pad di destinazione dello strato interno potrebbe non trovarsi nella posizione prevista dal progetto. Ogni ciclo di laminazione introduce un errore di registrazione XY di ±30–50 µm, poiché gli strati esterni si allineano ai punti di riferimento interni. In una produzione di Tipo I (due cicli), l'incertezza totale di posizione nel caso peggiore del centro del via rispetto al suo pad di destinazione raggiunge ±65–100 µm. Un pad di terra dimensionato solo in base alla precisione del laser, ignorando la registrazione, produrrà frequenti rotture dell'anello anulare in produzione.

La colonna "Minimo" rappresenta il limite geometrico al di sotto del quale la rottura è garantita in condizioni di normale variazione di registro. La colonna "Produzione sicura" rappresenta l'obiettivo corretto per i progetti destinati a una resa produttiva superiore al 97%.

Rapporto d'aspetto: il vincolo di affidabilità, non solo un parametro di rendimento

Secondo la norma IPC-2226, il rapporto d'aspetto massimo raccomandato per i fori ciechi è 1:1, ovvero la profondità divisa per il diametro non deve superare 1. In pratica, i dati di affidabilità mostrano che il vincolo è più stringente. I test con diversi rapporti d'aspetto dimostrano che i microfori con rapporto d'aspetto 0.7 superano i test di durata accelerati, mentre i microfori con rapporto d'aspetto pari a 1 si guastano entro pochi cicli termici. La modalità di guasto è la fatica del rame nella zona di transizione tra la parete del foro e il pad inferiore, dove si concentra la sollecitazione dovuta alla differenza di coefficiente di dilatazione termica (CTE) durante i cicli termici. Il foro supera il test elettrico iniziale a temperatura ambiente, ma si guasta sul campo.

La selezione del preimpregnato controlla direttamente il rapporto d'aspetto:

• Preimpregnato tipo 1080 con contenuto di resina del 65-70% polimerizza a 60-70 µm — con un via da 0.10 mm, rapporto d'aspetto = 0.65:1 ✓
• Preimpregnato tipo 2116 con contenuto di resina del 52–58% polimerizza a 110–130µm — con un via da 0.10 mm, rapporto d'aspetto = 1.1–1.3:1 ✗
• Il preimpregnato di tipo 7628 polimerizza a 170–200 µm — non utilizzare come dielettrico di accumulo esterno per qualsiasi via forata al laser

Specificare preimpregnati di tipo 1080 o 106 per tutti gli strati di accumulo esterni HDI. Questa singola modifica alla nota di fabbricazione consente di rispettare la maggior parte delle violazioni del rapporto d'aspetto senza modifiche al percorso di lavorazione e senza costi aggiuntivi. È inoltre fondamentale per la qualità delle pareti dei via: i preimpregnati con un contenuto di resina inferiore hanno un contenuto di fibra di vetro più elevato, che si abla in modo non uniforme sotto il laser a CO₂, producendo pareti dei via ruvide che aumentano i requisiti di desmear e riducono l'adesione della placcatura.

Via-in-Pad: quando è necessario e come specificarlo correttamente

La soluzione Via-in-pad prevede il posizionamento del via cieco direttamente all'interno del pad BGA o QFN, anziché in prossimità di esso. È necessaria quando il passo BGA è pari o inferiore a 0.40 mm con un elevato numero di I/O: la spaziatura tra i pad è insufficiente per instradare un via accanto al pad mantenendo la distanza minima dai pad adiacenti, rendendo il posizionamento all'interno del pad l'unica soluzione di fanout geometricamente praticabile.

Un via-in-pad non riempito assorbe la saldatura durante il processo di rifusione. La saldatura entra nel cilindro, non ritorna e il risultato è una giunzione con scarsa saldatura, con una conduttività adeguata per i test di continuità ma con una resistenza meccanica insufficiente per i cicli termici o le vibrazioni. Questa modalità di guasto supera tutti i controlli standard di fabbrica e si manifesta nei resi dal campo.

Le note di fabbricazione per i fori passanti nel pad devono specificare tutti e quattro gli elementi:

• Metodo di riempimento: Riempimento con placcatura in rame elettrolitico, non con resina epossidica o resinosa, che si ritira durante la polimerizzazione e lascia una depressione sulla superficie del tampone che influisce sul volume della pasta e sulla formazione del giunto.
• Planarizzazione: Planarizzazione chimico-meccanica (CMP) per una sporgenza ≤15 µm sopra il rame circostante per passo 0.40 mm; ≤25 µm accettabile per passo 0.50 mm
• Specifiche di vuoto: Area di vuoto nella sezione trasversale ≤10% secondo IPC-6012; specificare ≤8% per applicazioni che richiedono più di 500 cicli termici.
• Riduzione dell'apertura dello stencil: Ridurre l'apertura dello stencil della pasta in corrispondenza dei fori passanti nel pad all'80-90% dell'area nominale del pad per compensare la sporgenza del materiale di riempimento; questa informazione deve essere comunicata separatamente al tecnico di assemblaggio, in quanto non viene trasferita automaticamente dalle note di fabbricazione.

Selezione del tipo di build HDI: quale è quello effettivamente necessario per il tuo progetto?

Il tipo di costruzione HDI deve essere selezionato prima dell'inizio del layout. Determina quali coppie di layer supportano i via ciechi, quanti cicli di laminazione sono necessari per la scheda e qual è il costo. Scoprire un'incongruenza nel tipo di costruzione durante la revisione DFM (Design for Manufacturing) — dopo che il routing è stato completato — richiede il re-routing di ogni layer di escape HDI interessato.

Logica di selezione

Partite dal passo dei componenti più vincolato, determinate il tipo di via minimo che consente il fanout e verificate che tutte le coppie di strati critici per il segnale possano essere collegate con le coppie di via cieche disponibili in quel tipo di costruzione. Non scegliete il tipo II o III in modo speculativo: ogni ciclo di laminazione aggiuntivo aumenta il rischio di resa e allunga i tempi di consegna non comprimibili.

Se il vostro progetto prevede un BGA con passo di 0.50 mm che richiede solo via cieche L1→L2 per l'uscita, e il routing interno si completa su un core standard, il Tipo I è sufficiente e rappresenta la scelta economica corretta. Se lo stesso progetto prevede un BGA con passo di 0.40 mm in cui è obbligatorio l'utilizzo di via nel pad e un segnale critico deve transitare direttamente dalla superficie superiore a L3, è necessario il Tipo II: scoprirlo durante la fase di completamento del layout anziché prima di iniziarlo è un errore.

Microvias impilate vs. sfalsate: dati di affidabilità e compromessi di progettazione

Quando un percorso di segnale deve attraversare due strati dielettrici di accumulo, ad esempio da L1 a L3 in una struttura di tipo II, i due via che collegano L1→L2 e L2→L3 possono essere sfalsati o sovrapposti.

Sfalsato: I due via sono sfalsati orizzontalmente di ≥0.20 mm centro-centro. Ciascuno si trova sul proprio pad di cattura. Il pad intermedio (L2) deve essere dimensionato per ospitare sia l'anello anulare del via superiore sia la traccia di instradamento che si collega al via inferiore. Non è richiesto alcun riempimento di rame. Questa è la scelta predefinita: costi inferiori, maggiore affidabilità, produzione più semplice.

Impilato: Entrambi i fori di via condividono le stesse coordinate X/Y. Il foro di via inferiore (L2→L3) deve essere riempito di rame e planarizzato mediante CMP prima della laminazione del buildup superiore, poiché il foro di via superiore (L1→L2) viene forato direttamente sulla superficie di riempimento planarizzata. Questa operazione è necessaria solo in presenza di array di escape BGA estremamente densi, dove un offset orizzontale di 0.20 mm non è geometricamente possibile.

I dati raccolti finora suggeriscono che le microvias sovrapposte, costituite da 3 o più strati, hanno una probabilità di guasto molto maggiore rispetto alle strutture di microvias sfalsate. Per le microvias sovrapposte a due livelli, l'affidabilità dipende in modo critico dalla qualità del riempimento:

La specifica dei vuoti è importante perché questi concentrano lo stress termico al confine del vuoto durante i cicli. Un via impilato con un'area della sezione trasversale vuota del 20% si guasterà in una frazione dei cicli di una struttura sfalsata equivalente, e il guasto supererà il test elettrico iniziale. Verificare sempre con il produttore che utilizzi una chimica di placcatura pulsata dal basso verso l'alto (non la placcatura elettrolitica conforme standard) per il riempimento dei via. La placcatura conforme standard chiude l'apertura del via prima di riempire il centro, producendo di routine vuoti del 20-40%. La chimica dal basso verso l'alto riempie dal pad di arresto verso l'alto, raggiungendo costantemente valori ≤8%.

Prima di optare per via impilate, è consigliabile progettare prima con via sfalsate. Molti progetti che si presume richiedano via impilate possono essere realizzati con configurazione sfalsata con un'area di fanout aggiuntiva del 5-8%. La differenza in termini di costi, affidabilità e rischio di produzione è sostanziale.

Costo dei circuiti stampati Blind Via: fattori determinanti, moltiplicatori e aspetti che i progettisti possono controllare.

Perché il sovrapprezzo è maggiore di quanto suggerisca il numero di strati

Il sovrapprezzo di un PCB con laminazione cieca via è determinato dalla complessità del processo e dal rischio di resa cumulativo, non dal costo del materiale. Ogni ciclo di laminazione aggiunge 8-12 ore di tempo di processo non comprimibile (ciclo di pressatura, tempo di polimerizzazione e raffreddamento controllato), oltre all'ispezione tra i cicli, alla verifica della registrazione e alla possibilità di scartare il pannello in qualsiasi momento. Una produzione di tipo III con quattro cicli di laminazione non costa 4 volte di più rispetto a una scheda standard a ciclo singolo; costa di più perché ogni ciclo comporta una probabilità di errore di processo dell'1-3%, e queste probabilità si sommano: su quattro cicli, la probabilità di almeno un errore a livello di ciclo si avvicina al 4-12%.

Tre tipologie di costi di processo rappresentano il 50-65% del premio totale sul costo unitario:

• Cicli di laminazione: Il tempo minimo non comprimibile per ciclo è di 8-12 ore. Una costruzione di tipo III a quattro cicli prevede un tempo minimo di laminazione di 32-48 ore prima di qualsiasi foratura, placcatura o incisione. È da qui che derivano sia i tempi di consegna che i costi.
• Foratura laser: Il costo di installazione per pannello varia da 80 a 250 dollari, indipendentemente dal numero di vie, più 0.008-0.025 dollari/via per il laser a CO₂ o 0.015-0.040 dollari/via per il laser UV. Su un pannello con 600 vie cieche, la sola foratura aggiunge 35-75 dollari a pannello.
• Riempimento con rame e planarizzazione CMP: Necessario per via impilate e via-in-pad. Il riempimento aggiunge $0.05–0.15/via; la planarizzazione CMP aggiunge $1.50–5.00/pannello. Per un progetto con 600 via che utilizza via impilate rispetto a via sfalsate, questa sola differenza può raggiungere $30–95/scheda.

Quattro scelte progettuali che riducono i costi senza compromettere le prestazioni.

• Utilizza il tipo HDI più basso che ti permette di eseguire il routing. Il passaggio dal Tipo I al Tipo III comporta un moltiplicatore di costo di 2-3 volte sul sovrapprezzo HDI, senza contare la foratura laser e il riempimento. Se tutti i fanout BGA vengono realizzati in connessioni L1→L2, il Tipo I è sufficiente.
• Specificare microvias sfalsate laddove il percorso lo consenta. La disposizione sfalsata elimina completamente il ciclo di riempimento del rame e la lucidatura chimico-meccanica (CMP). Con 600 vie per pannello, ciò si traduce in una differenza di costo di elaborazione per scheda compresa tra 30 e 95 dollari, con una maggiore affidabilità.
• Utilizzare fori passanti da 0.15 mm anziché da 0.10 mm laddove il passo lo consenta. Con un passo BGA di 0.50 mm, i via da 0.15 mm sono geometricamente fattibili e costano il 40% in meno per via in fase di foratura, hanno una resa superiore al 99% rispetto al 97-98% per i via da 0.10 mm e presentano intrinsecamente rapporti di aspetto migliori. Nessun compromesso elettrico.
• Specificare 1080 prepreg negli strati di accumulo HDI. Il 1080 con uno spessore di polimerizzazione di 65–70 µm riduce il rapporto d'aspetto da 1.1–1.3:1 (prepreg 2116) a 0.65:1, migliorando la resa al primo passaggio, riducendo i costi di perforazione e aumentando l'affidabilità sul campo. Il costo del materiale è equivalente.

Valutazione di un produttore di PCB con via cieca: le domande che rivelano la sua capacità

Domande sulla capacità di processo

La fabbricazione di circuiti stampati HDI blind via richiede attrezzature specializzate e una disciplina di processo che molti produttori di PCB non possiedono realmente. Queste considerazioni distinguono le aziende con reali capacità da quelle che avranno difficoltà a gestire grandi volumi:

• “Quali tipi di HDI producete internamente e qual è il numero di cicli di laminazione per ciascuno?” Un produttore competente specifica i tipi I, II, III e qualsiasi strato, con i relativi conteggi di cicli. Una risposta vaga, come "realizziamo HDI" o "supportiamo i via ciechi", senza dettagli specifici sul processo, indica che probabilmente esternalizzano le assemblaggi più complessi o che hanno un'esperienza limitata con tecnologie diverse dal tipo I.
• "Qual è il diametro minimo del vialetto cieco finito che potete realizzare separatamente con laser a CO₂ e laser UV?" 0.10 mm di CO₂ è la capacità di produzione standard. Un laser UV da 0.075 mm indica attrezzature più avanzate. Qualsiasi valore dichiarato inferiore a 0.075 mm deve essere verificato con dati di sezione trasversale, poiché si tratta di una capacità specialistica che poche officine possiedono in modo affidabile in produzione.
• "Qual è la precisione di allineamento tipica tra i vari strati dopo il secondo ciclo di laminazione?" Il valore di riferimento: ±35–50 µm rappresenta una solida capacità standard. ±25–30 µm è un valore avanzato. Un produttore che non è in grado di rispondere a questa domanda con un valore numerico non dispone del monitoraggio del controllo di processo necessario per mantenere in modo affidabile pad di 0.30 mm su via cieche da 0.10 mm in produzione.
• "Qual è la percentuale di vuoto che si mantiene nelle vie impilate riempite di rame e quale materiale di riempimento si utilizza?" Risposta corretta: ≤10% di vuoti secondo IPC-6012, con obiettivo ≤8%, utilizzando la chimica di placcatura a impulsi bottom-up. Un'officina che utilizza la galvanica conforme standard per il riempimento produrrà vuoti del 20-40% — strutturalmente conformi a un'ispezione superficiale, ma inaffidabili nei cicli termici.
• "Come si gestiscono le violazioni delle coppie di layer via cieche nella revisione DFM?" Un'officina rigorosa segnala le coppie di via specifiche con le relative coordinate, identifica il tipo di costruzione necessario per risolvere la violazione e lo comunica al progettista entro 24 ore. Un'officina che invia in produzione progetti con coppie di via impossibili, o che risolve le violazioni sostituendo il tipo di costruzione senza notificare l'errore, genera guasti sul campo.

Requisiti di documentazione per i programmi di produzione

Per qualsiasi programma di produzione di circuiti stampati ciechi che superi le quantità di prototipo, si prega di richiedere i seguenti elementi come forniture standard:

• Registri di ispezione interciclo: misurazione della registrazione a raggi X e mappatura dello spessore del pannello tra ogni ciclo di laminazione, non a campione, ma sul 100% dei pannelli.
• Report dei campioni di impedenza TDR: valori di impedenza misurati specifici per lotto con registrazioni della forma d'onda, non documentazione media di processo.
• Sezione trasversale del primo articolo: sezione trasversale microscopica di vie cieche rappresentative che verifica lo spessore della placcatura in rame al ginocchio della via (IPC-6012 Classe 3 minimo: 12 µm), la percentuale di vuoto e la registrazione del pad di cattura.
• Tracciabilità del lotto di materiale: lotto di preimpregnato, lotto di lamina di rame e lotto di anima del laminato collegati alla scheda di produzione per l'analisi dei guasti sul campo.

Capacità di Highleap di realizzare PCB con via cieca

Elettronica Highleap Produce PCB con via cieca di tipo I, III e HDI a qualsiasi strato, con le seguenti metriche di produzione verificate:

• Sistemi laser: CO₂ (diametro finito minimo 0.10 mm, FR4 e laminati standard); UV (minimo 0.075 mm, un laminato speciale a bassa perdita, PTFE, compatibile con Megtron 6/7)
• Tramite riempimento: Chimica di placcatura pulsata bottom-up; specifica dei vuoti ≤8%; planarizzazione CMP fino a una sporgenza superficiale ≤15µm
• Registrazione: ±35µm di tolleranza tipica tra gli strati dopo il secondo ciclo di laminazione; controllo di registrazione a raggi X al 100% su tutti i pannelli tra i cicli.
• DFM: Verifica cieca tramite controllo delle coppie di layer e del rapporto d'aspetto su ogni preventivo HDI: le coppie di layer impossibili vengono restituite con indicazioni correttive specifiche entro 24 ore.
• Documentazione: Report sui coupon TDR per lotto, registri delle ispezioni inter-ciclo e tracciabilità del lotto di materiale come elementi standard delle spedizioni.
• Capacità di sviluppo: Tipo I fino al Tipo III; HDI a qualsiasi strato fino a 4 strati di accumulo per faccia; ibridi HDI rigido-flessibili

Per il processo di laminazione sequenziale completo, inclusi i parametri del ciclo di pressatura, il protocollo di ispezione inter-ciclo, le cause principali dei difetti e i dati di resa per tipo di costruzione, vedere il Guida alla laminazione cieca dei PCB e alla prevenzione dei difetti.

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