目录 高层数设计材料要求 芯材和预浸料选择 层压良率考虑因素 翘曲和套准管理 材料交货期挑战 制造商叠层审查流程 高层数PCB材料常见问题解答 A...
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AI服务器PCB材料：低损耗层压板、叠层结构、散热和PCBA指南
本页内容包括：AI服务器PCB材料选择指南；如何满足不同AI服务器电路板的材料需求；如何选择低损耗层压板；铜箔、玻璃布、树脂体系和叠层设计；散热、供电和可靠性等。
适用于高速数字和射频应用的低损耗PCB制造
本页内容包括：什么是低损耗PCB制造？何时需要低损耗PCB制造？低损耗PCB制造中常用的材料？低损耗PCB的制造能力？如何降低订购低损耗PCB前的风险？如何选择低损耗PCB制造商？……
低介电常数、低损耗的PCB材料，适用于高速信号传输
图 1. 高速电路板的低损耗 PCB 材料选择。本页内容：低介电常数 (Dk) 和低介电损耗 (Df) 的含义；信号损耗降低的优势；低介电常数材料与 FR4 的比较；制造注意事项；成本和交货时间因素；低介电常数/低介电损耗材料常见问题解答；两个数字……
适用于DDR5和PCIe的10层高速PCB工程
图 1. 用于 DDR5 和 PCIe 布线的 10 层高速 PCB。目录：从通道而非协议标签入手；数据速率的意义（以及它不能告诉你什么）；构建插入损耗和断路预算；材料、铜和几何形状的综合选择……
10层PCB阻抗控制和TDR验证
图 1. 10 层 PCB 阻抗控制试片及 TDR 验证。目录：受控阻抗是发布走线几何形状之前所需的叠层和工艺定义输入；单端、奇模和差分阻抗微带线……
用于阻抗和平面的 10 层 PCB 叠层设计
图 1. 用于阻抗和平面规划的 10 层 PCB 叠层结构。目录：在选择介质层厚度之前选择层架构；三种有用的 10 层叠层结构原型；一个包含参考平面的 10 层示例；压出、铜和阻抗闭合……
DDR5、PCIe 和串扰的 10 层 PCB 布线规则
图 1. DDR5 PCIe 和串扰的 10 层 PCB 布线规则。目录：布线开始前冻结电气规则；层分配和回流路径连续性；差分对：几何形状、偏移和转换；DDR5 和其他并行存储器……
十层PCB制造商，生产刚挠性、柔性及刚挠性PCB。
图 1. 十层 PCB 制造商的生产能力。目录：适用于刚性、柔性及刚柔结合板的十层 PCB 制造商；如何选择十层 PCB 制造商；十层 PCB 的可制造性设计 (DFM)、材料选择及生产前设计支持；十层 PCB……
10层AI服务器PCB设计，适用于加速器硬件
图 1. 用于加速器硬件的 10 层 AI 服务器 PCB。目录：10 层 PCB 在 AI 基础设施中的应用；选择叠层结构前的电路板分类；加速器封装、HBM 和 PCB 边界；PCIe、CXL 和以太网通道工程……