DDR5-Modul-Leiterplatten-Fertigungsleitfaden

DDR5 ist der Speicherstandard für Serverplattformen, KI-Workstations und leistungsstarke Consumer-Systeme der Jahre 2024–2025. Für Hardware-Ingenieure und Einkaufsteams, die Leiterplatten für DDR5-Speichermodule beschaffen – sei es für die DIMM-Produktion, die Server-OEM-Belieferung oder kundenspezifische Industriespeicher – sind die Fertigungsanforderungen deutlich strenger als bei DDR4. Signalgeschwindigkeiten von 4800 MT/s bis zu 7200 MT/s in der Produktion, kombiniert mit der On-Module-PMIC-Regelung und engeren Impedanzfenstern, bedeuten, dass ein Standard-Leiterplattenhersteller Module produziert, die die Signalintegritätsprüfung nicht bestehen, bevor sie überhaupt ein JEDEC-Konformitätslabor erreichen.

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1. Warum DDR5-Modul-Leiterplatten einen spezialisierten Hersteller erfordern

1.1 Strukturelle Änderungen von DDR4 zu DDR5

DDR5 führte mehrere architektonische Änderungen ein, die sich direkt auf das Design und die Fertigung von Leiterplatten auswirken:

• On-Module PMIC: DDR5 verlagert die Spannungsregelung (VDD und VDDQ) direkt auf den DIMM-Speicher. Der PMIC übernimmt die lokale Regelung, wodurch die Leiterplatte höhere transiente Ströme aushalten muss – was zu höheren Anforderungen an die Wärmeableitung und das Kupfergewicht führt, die bei DDR4 nicht bestanden.
• Punkt-zu-Punkt-Bus in Kalifornien: DDR5 ersetzt die gemeinsame Fly-by-Befehls-/Adresstopologie von DDR4 durch eine individuelle Punkt-zu-Punkt-Verbindung zu jedem DRAM-Baustein, wodurch die Routingdichte erhöht und ein individueller Längenabgleich pro Baustein erforderlich wird.
• Engere Zeitspielräume: Bei 6400 MT/s beträgt die Datenlatenz von DDR5 etwa 156 ps – die Hälfte der Toleranz von DDR4-3200. Jegliche durch Fehlanpassungen der Impedanz, Übersprechen oder Längenfehler auf der Leiterplatte reduzieren diese Latenz direkt.

Hersteller, die routinemäßig hochdichte Multilayer-Leiterplatten mit präziser dielektrischer Kontrolle herstellen, sind besser in der Lage, die von DDR5 geforderte Leiterbahngeometrie auf einer gesamten Produktionsplatine zu gewährleisten – und nicht nur auf einem Prototypen.

1.2 Wichtige Signalgruppen auf einem DDR5-Modul

• DQ/DQS: Die Datenbusintegrität bestimmt den dauerhaften Lese-/Schreibdurchsatz und die Fehlerrate unter thermischer Belastung.
• Differenzialtakt CK_t/CK_c: Ein einzelnes Taktpaar steuert den gesamten DRAM auf dem Modul; jede Unterbrechung führt zu Jitter an jedes Gerät.
• CA-Bus: Punkt-zu-Punkt-Routing bedeutet, dass die CA-Signale zu jedem DRAM einzeln längenangepasst sein müssen.
• PMIC-Stromversorgung: Niederohmige VDD/VDDQ-Ebenen müssen bei Lastsprüngen von 10–50 A eine saubere Versorgungsspannung liefern.

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2. Schichtaufbau und Spezifikationen für kontrollierte Impedanz

2.1 Typischer 8-Lagen-UDIMM-Stack

L1 – Oberes Signal: DQ-Routing, BGA-Fan-Out, PMIC-Pads L2 – GND-Ebene: Referenz für die Signalebene L1 L3 – Signal: CA-Bus, Hilfssignale L4 – VDD/VDDQ-Ebene: Stromverteilung L5 – GND-Ebene: Referenz für die Signalebene L6 L6 – Signal: CK, RAS/CAS-Routing L7 – GND-Ebene: Rückleitung L8 – Unteres Signal: DQ-Routing, Pads für passive Bauelemente

Die symmetrische GND-Signal-GND-Anordnung auf den äußeren Lagen ist Standard. Hersteller, die die Dicke des inneren Dielektrikums nicht innerhalb von ±10 % über die gesamte Produktionsfläche einhalten können, liefern Platinen mit variabler Impedanz. Dies äußert sich in zufälligen Speicherfehlern unter Last und nicht in vorhersehbaren Ausfällen. Für die DDR5-Produktion ist die Fertigung mit kontrollierter Impedanz und TDR-Coupon-Verifizierung auf jeder einzelnen Platine unerlässlich.

2.2 Zielimpedanzwerte

2.3 Minimale Fertigungsparameter

• Minimale Leiterbahnbreite: 75 µm (3 mil) für DQ-Routing in der Nähe von x8 DRAM BGAs
• Mindestbohrdurchmesser: 0.20 mm für Signaldurchkontaktierungen; 0.15 mm Laser-Durchkontaktierung für HDI RDIMM/LRDIMM-Varianten
• Schicht-zu-Schicht-Registrierung: ±0.075 mm oder besser für 8-lagige Leiterplatten
• Basismaterial: Hochtemperatur-FR-4 (Tg ≥ 150 °C); Shengyi S1000H oder gleichwertiges halogenfreies Material für bleifreie Montage

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3. Goldfinger-Kantenverbinder: Anforderungen gemäß JEDEC MO-002

3.1 Warum Hartgold – nicht ENIG – erforderlich ist

Jedes DDR5-DIMM verfügt über einen 288-poligen Kantenstecker gemäß JEDEC MO-002. Die Kontakte müssen mit Hartgold (elektrolytischem Nickel-Gold) beschichtet sein : 3–5 µm Nickel-Unterschicht, 0.76–1.27 µm Gold. Weiches ENIG (Immersionsgold, typischerweise 0.05–0.15 µm) verschleißt bei häufigem Stecken und Einstecken schnell und führt innerhalb von 10–20 Zyklen zu einem erhöhten Kontaktwiderstand. Hersteller, die kein Dual-Finish-Verfahren (ENIG-Körper + elektrolytisches Hartgold auf den Kontakten) anwenden, können keine JEDEC-konformen DDR5-Module produzieren.

Zusätzliche Maßvorgaben:

• Fasenwinkel: 45°-Fase an der Unterkante, kontrolliert auf ±2°
• Schlüsselschlitzposition: Abweichungen von ±0.10 mm von der JEDEC MO-002-Zeichnung sind möglich – die Teile sind CNC-gefräst, nicht gerillt.
• Lötmaskenabstand: Keine Beeinträchtigung der Goldkontaktfläche durch die Maske.

3.2 Häufige Goldfinger-Defekte, auf die geachtet werden sollte

• Lötstopplackbrücken auf den Kontaktfingern → Kontaktwiderstandsausfall
• Unzureichende Golddicke (< 0.5 µm) → Nichtbestehen des Lebensdauertests im Einsteckzyklus
• Fehlender oder falsch positionierter Schlüsselsteckplatz → physisch inkompatibel mit DDR5-Steckplatz
• Falsche Fase → mechanische Spannung an der Leiterplattenkante beim Einsetzen

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4. SMT-Bestückung für DDR5-DRAM- und PMIC-Gehäuse

4.1 Stückliste für ein Standard-DDR5-UDIMM

• 8–16× DRAM-Bausteine: FBGA-78 (x8) oder FBGA-96 (x4) Gehäuse mit 0.75–0.80 mm Rastermaß (Samsung K4RAH, SK Hynix H5C, Micron MT60B Serie)
• 1× PMIC: BGA- oder QFN-Gehäuseverarbeitung VDD/VDDQ-Regelung (z. B. Renesas RAA229004, MPS MP2925)
• 1× SPD-Nabe: Serieller Präsenzerkennungs-Hub mit I3C-Schnittstelle (SPD5118 oder kompatibel)
• Passive: 0201- und 01005-Entkopplungskondensatoren, Serienwiderstände, Abschlussnetzwerke

Die Dichte der passiven Bauteile auf einem DDR5 UDIMM – insbesondere der 01005-Entkoppler – erfordert eine SMT-Bestückungslinie, die für die Platzierung von Bauteilen im Submillimeterbereich ausgestattet ist, und keine generische Produktionsanlage im mittleren Preissegment.

4.2 Feuchtigkeitsempfindlichkeit und Reflow-Anforderungen

DDR5-DRAM-Gehäuse sind gemäß MSL-3 für 168 Stunden Lagerfähigkeit bei ≤30 °C/60 % relativer Luftfeuchtigkeit nach dem Öffnen der Trockenverpackung ausgelegt. Wird diese Lagerfähigkeit überschritten, ist eine 24-stündige Trocknung bei 125 °C erforderlich. Fertigungslinien ohne dokumentierte MSL-Kontrollen produzieren Platinen mit latenten Popcorning-Fehlern, die erst im Feldeinsatz und nicht im Endtest sichtbar werden.

Reflow-Profilziele für SAC305:

• Höchsttemperatur: 245–255 °C
• Zeit oberhalb der Liquiduslinie (TAL): 45–60 Sekunden
• Aufheizrate: ≤ 2 °C/s Vorheizen, ≤ 3 °C/s Anstieg bis zum Spitzenwert
• Abkühlung: ≤ 4°C/s (kontrollierte Kühlung verhindert Schäden an der Lötstellenmikrostruktur)

4.3 BGA-Platzierungsgenauigkeit

FBGA-Gehäuse mit einem Rastermaß von 0.75–0.80 mm erfordern eine Bestückungsgenauigkeit von ±25 µm (3σ) . Eine Maschine mit einer Genauigkeit von ±50 µm – ausreichend für ein Rastermaß von 1.0 mm – ist unzureichend; Verschiebungen bei einem Rastermaß von 0.75 mm führen zu offenen BGA-Kontakten, die mit AOI nicht sichtbar und nur per Röntgenprüfung erkennbar sind. Die Inspektionsreihenfolge nach dem Reflow sollte wie folgt lauten: SPI → AOI → Röntgenprüfung aller BGA-Gehäuse → elektrische Prüfung.

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5. RDIMM und LRDIMM: Zusätzliche Komplexität

Gepufferte DDR5-Module enthalten einen Registertakttreiber (RCD, z. B. Montage MTC10F2064 oder Renesas RCD04) und optional einen Datenpuffer (DB) für LRDIMM. Aus fertigungstechnischer Sicht:

• Höhere Schichtanzahl: Für eine saubere Verlegung der CA/CS-Kanäle vom RCD zu jedem DRAM-Array sind 8–10 Schichten erforderlich.
• Weitere BGA-Gehäuse: RCD- und DB-Chips mit einem Rastermaß von 0.65–0.80 mm erfordern die gleiche Feinrasterung und Röntgenprüfung wie DRAM-Gehäuse.
• CA-Busverzweigung: Die RCD leitet CA/CS-Signale an alle DRAM-Bausteine ​​des Moduls weiter – die Fächerleitung ist der am stärksten ausgelastete Bereich eines RDIMM-Layouts und begründet den Bedarf an zusätzlichen Signalebenen.

Bei LRDIMM-Designs beseitigt die schlüsselfertige Fertigung, die Leiterplattenherstellung und -bestückung unter einem Dach vereint, das Qualitätsrisiko bei der Übergabe zwischen einem Rohplatinenlieferanten und einem separaten Bestückungsbetrieb – besonders wichtig, wenn sowohl die Lagenanzahl als auch die BGA-Dichte hoch sind.

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6. Inspektion und Prüfung von der unbestückten Platine bis zum fertigen Modul

6.1 Qualitätskontrolle der Leiterplattenfertigung

• TDR-Impedanzbericht: Gemessene Werte von Coupons auf jedem Panel — DQ (40Ω), DQS/CK (85–100Ω Differenz), CA (50Ω)
• AOI: Prüfung der Innen- und Außenschicht auf Spurenfehler und Padqualität
• E-Prüfung: Kontinuität und Isolation der fliegenden Sonde auf jedem Panel
• Mikroschnitt: Querschnittsprobe mit Angabe der Kupferdicke, der dielektrischen Dicke und der Durchkontaktierungsqualität pro Produktionscharge

6.2 Montage- und Modulprüfung

• Röntgeninspektion: BGA-Verbindungsprüfung für alle DRAM-, PMIC- und RCD/DB-Gehäuse
• SPD-Programmierung und -Rücklesung: Bestätigt, dass der SPD-Hub korrekt montiert ist und der EEPROM programmierbar ist.
• Speicherkontrollertest: Enumeration auf einer Referenzplattform, Lese-/Schreibmustertest bei Nenngeschwindigkeit, thermischer Stresstest bestanden/nicht bestanden

Die vollständige Testsequenz – vom TDR-Bericht der unbestückten Platine bis hin zu elektrischen Funktionstests auf Modulebene – schließt den Regelkreis für jeden potenziellen Fehlermodus, bevor die Module etikettiert und versendet werden.

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7. Fragen, die Sie vor der Bestellung eines DDR5-Moduls stellen sollten

Bevor Sie Produktionsmengen festlegen, sollten Sie sich von jedem potenziellen DDR5-Modulhersteller klare Antworten auf diese Fragen einholen:

1. Wie hoch ist Ihre Toleranz gegenüber kontrollierter Impedanz, und liefern Sie mit jeder Lieferung TDR-Coupon-Daten? ±10 % ist das DDR5-Ziel; ±15 % ist die Toleranz aus der DDR3-Ära.
2. Können Sie Leiterplatten mit zwei Oberflächen herstellen – ENIG-Gehäuse mit elektrolytisch hartvergoldeten Kantensteckerkontakten?
3. Wie hoch ist Ihre Platzierungsgenauigkeit für DRAM-Gehäuse mit einem Rastermaß von 0.75–0.80 mm?
4. Verfügen Sie über eine hauseigene Röntgeninspektion? Ausgelagerte Röntgenprüfung bedeutet, dass kein Echtzeit-Feedback in den Montageprozess einfließt.
5. Wie sieht Ihr MSL-Kontrollverfahren für DDR5-DRAM-Gehäuse aus?
6. Können Sie den gesamten Prozess – von der Fertigung bis hin zu geprüften Modulen – mit einer einzigen Produktionsstätte abdecken?

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